Quartus II 軟件11.0增強了調(diào)試方案，幫助您更快的完成電路板開發(fā)。這些增強措施包括外部存儲器接口工具包的性能監(jiān)視功能，它提高了收發(fā)器工具包的可用性。凱薩督姆 ii 11正式版支持Altera名為Qsys的系統(tǒng)級集成工具新產(chǎn)品，實現(xiàn)了對Stratix® V FPGA系列的擴展支持，并且采用增強后的調(diào)試方案加快了電路板開發(fā)。

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Qsys在成功的SOPC Builder基礎(chǔ)上，實現(xiàn)了新的系統(tǒng)開發(fā)特性以及新的高性能互聯(lián)，從而進一步提高了FPGA設(shè)計人員的效能。Qsys為FPGA設(shè)計人員提供的優(yōu)勢包括：

自動產(chǎn)生互聯(lián)，提供即插即用Qsys編譯知識產(chǎn)權(quán)(IP)內(nèi)核，加快了開發(fā)過程。

Altera及其IP合作伙伴提供很多Qsys編譯IP內(nèi)核，包括接口協(xié)議(例如，PCI Express®)、存儲器(例如，DDR3)、處理器(例如，Nios®?II處理器)，以及視頻和圖像處理宏功能(例如，去隔行器)等。

基于芯片網(wǎng)絡(NoC)體系結(jié)構(gòu)的高性能Qsys互聯(lián)，更快的達到時序收斂。

與SOPC Builder相比，支持自動流水線的Qsys互聯(lián)性能提高了兩倍。

支持標準接口和分層，設(shè)計人員可以重新使用Qsys生成的系統(tǒng)作為另一Qsys系統(tǒng)的子系統(tǒng)，從而增強了設(shè)計重用。

自動產(chǎn)生測試臺，適用于驗證多種IP，支持使用讀寫操作進行片內(nèi)調(diào)試，更迅速的完成驗證。

Qsys實例：PCI Express至外部存儲器(DDR3)參考設(shè)計

如果不熟悉PCIe協(xié)議，開發(fā)基于PCI Express (PCIe®)的系統(tǒng)具有一定的難度，比較耗時。現(xiàn)在提供很多常用的IP內(nèi)核，包括基于PCIe的硬核IP，并提供使用方便的存儲器映射接口。Qsys在這些IP內(nèi)核與其他設(shè)計模塊之間自動產(chǎn)生互聯(lián)，從而加快了系統(tǒng)開發(fā)過程。為演示Qsys兼容IP內(nèi)核的應用以及互聯(lián)性能，Altera開發(fā)了基于Qsys的PCIe至DDR3設(shè)計，使用了Gen2 x4性能最優(yōu)端點，與DDR3存儲器控制器進行通信，同時實現(xiàn)了較高的持續(xù)吞吐量，直接存儲器訪問(DMA)讀或者寫DDR3大于1400 MBps。

Quartus II 訂購版和網(wǎng)絡版軟件都支持Qsys。關(guān)于Qsys的詳細信息，請訪問Qsys產(chǎn)品頁面。

采用增強后的調(diào)試方案加快電路板開發(fā)

外部存儲器接口工具包中新的性能監(jiān)視功能幫助設(shè)計人員提高存儲器效率，從而增強了效能。通過實時跟蹤并報告存儲器系統(tǒng)的效率，設(shè)計人員研究不同的存儲器控制器設(shè)置，從而找到最優(yōu)設(shè)置。設(shè)計人員還可以使用監(jiān)視功能，優(yōu)化自己的數(shù)據(jù)流碼型。性能監(jiān)視器功能完善了外部存儲器接口工具包的現(xiàn)有功能，幫助設(shè)計人員校準、優(yōu)化并調(diào)試其存儲器。

收發(fā)器工具包增強了通道管理器接口，更新了收發(fā)器控制面板?，F(xiàn)在，通道管理器接口提供鏈路和通道(發(fā)送器和接收器)的實時狀態(tài)，幫助設(shè)計人員迅速找到哪些鏈路成功，哪些鏈路失敗。與前一版本相比，更新后的收發(fā)器控制面板支持用戶同時查看并編輯鏈路(發(fā)送器和接收器)中所有通道的設(shè)置，同時顯示更多的收發(fā)器狀態(tài)信息。對收發(fā)器工具包的這些改進有助于設(shè)計人員優(yōu)化收發(fā)器，提高信號完整性，更迅速的完成電路板開發(fā)。

增強芯片規(guī)劃器——設(shè)計并驗證Stratix V FPGA收發(fā)器時，提高了可用性。通過更詳細、更直觀的布局，設(shè)計人員能夠更好的管理其收發(fā)器資源。

DSP Builder擴展操作系統(tǒng)(OS)支持——增加了對位Windows和Linux的支持。

最新的IP內(nèi)核——去隔行器II IP內(nèi)核

擴展Stratix V FPGA支持

Quartus II軟件11.0為Stratix V FPGA提供擴展收發(fā)器模式和功能支持，包括：

支持GigE和SDI收發(fā)器模式

新的收發(fā)器功能支持包括接收器失調(diào)校準、線性均衡器以及PMA模式設(shè)置的動態(tài)重新配置等。

Cyclone?IV GX FPGA

現(xiàn)在為所有Cyclone®?IV GX器件提供最終時序模型

為所有Cyclone IV GX器件提供POF支持

MAX V CPLD

汽車器件支持包括新的-5A速率等級

現(xiàn)在為所有MAX®?V器件提供POF支持

為所有MAX V器件提供最終時序和功耗模型